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Makefile 描述的是文件编译的规则,一条规则主要由两部分组成,依赖关系和命令:
targets : prerequisites command
Makefile中主要包含的内容:
make的执行过程:
在shell中执行make之后,会自动搜索Makefile文件,并且将脚本中的第一条规则
定义的目标作为最终目标,然后检查目标的依赖,这时有三种情况:
Makefile 支持shell中的通配符,如下:
通配符 | 说明 |
---|---|
* | 匹配0个或多个任意字符 |
? | 匹配任意一个字符 |
[] | 匹配方括号中制定的字符 |
通配符在引用变量时的使用,在写依赖规则时,如果直接使用有通配符的变量,会出现错误。如
obj = *.ctest : $(obj) gcc -o $@ $^
当按如上规则make时,会报错找不到*.c。这是因为变量引用中的通配符并不会被展开。而如果想在引用的变量中使用通配符,则需要借助wildcard函数,这个函数会在引用变量时进行通配符的展开,如:
obj = $(wildcard *.c)test : $(obj) gcc -o $@ $^
Makefile 中还支持 % 通配符,也是匹配任意个字符,
test : test1.o test2.o gcc -o $@ $^%.o : %.c gcc -o $@ $^
%.o会把所有.o文件组合成一个列表,每次从列表中取出一个文件,然后找到文件中和%名称相同的.c文件,然后执行下面的文件,直至列表中的文件取完。这个属于Makefile中静态模规则:规则存在多个目标,规则存在多个目标,并且不同的目标可以根据目标文件的名字自动构造出依赖文件。
变量名称 = 值列表
变量名称可以由字母数字和下划线构成,等号左右的空格没有要求,值列表可以是0项,也可以是多项,中间用空格分隔。
OBJ = a.o b.o c.otest : $(OBJ) gcc -o test $(OBJ)
x = abcy = $(x)dx := efg # 简单赋值 x=efg, y=abcdx = efg # 递归赋值 x=efg, y=efgdx ?= efg # 条件赋值 x=abc, y=abcdx += efg # 追加赋值 x=abc efg, y=abcd
自动化变量 | 说明 |
---|---|
$@ | 表示规则的目标文件名。如果目标是一个文档文件(Linux 中,一般成 .a 文件为文档文件,也成为静态的库文件), 那么它代表这个文档的文件名。在多目标模式规则中,它代表的是触发规则被执行的文件名。 |
$% | 当目标文件是一个静态库文件时,代表静态库的一个成员名。 |
$< | 规则的第一个依赖的文件名。如果是一个目标文件使用隐含的规则来重建,则它代表由隐含规则加入的第一个依赖文件。 |
$? | 所有比目标文件更新的依赖文件列表,空格分隔。如果目标文件时静态库文件,代表的是库文件(.o 文件)。 |
$^ | 代表的是所有依赖文件列表,使用空格分隔。如果目标是静态库文件,它所代表的只能是所有的库成员(.o 文件)名。 一个文件可重复的出现在目标的依赖中,变量$^ 只记录它的第一次引用的情况。就是说会去掉重复的依赖文件。 |
$+ | 类似“$^”,但是它保留了依赖文件中重复出现的文件。主要用在程序链接时库的交叉引用场合。 |
$* | 在模式规则和静态模式规则中,代表“茎”。“茎”是目标模式中“%”所代表的部分(当文件名中存在目录时, “茎”也包含目录部分)。 |
有两种方式可以制定Makefile脚本搜索目标文件的目录路径:一般搜索VPATH
和选择搜索vpath
.
VPATH和vpath的区别在于,VPATH是一个变量,而且是环境变量,使用时需要指定文件的路径;vpath是关键字,按照指定的模式搜索,搜索时不仅要加上路径,还要加上限值条件。
在Makefile中按如下形式使用VPATH指定搜索路径:
VPATH := src
当要指定多个路径时,不同的路径之间用空格或者冒号分隔。
VPAHT := path1:path2
vpath按照给定模式在指定目录中搜索,使用方法如下:
1. vpath PATTERN DIRECTORIES2. vpath PATTERN3. vpath
用法二的意思是清除符合模式 的搜索目录,用法3 单独使用vpath是清楚所有已设置的文件搜索路径。
假设现在有一个工程,包含两个目录,src目录下包含main.c, module1.c, module2.c源文件,inc目录下包含module1.h, module2.h头文件。通过如下方式先声明文件搜索路径。
vpath %.c srcvpath %.h inc ## 或者使用 VPATH = src incmain : main.o module1.o module2.o gcc -o $@ $
在实际工程中,经常会遇到要根据某个条件执行不同的编译操作的情况。这是就需要在Makefile中能够实现分条件执行语句的功能。Makefile中提供以下条件判断关键字:
关键字 | 说明 | |
---|---|---|
ifeq | 判断参数是否相等 | |
ifneq | 判断参数是否不等 | |
ifdef | 判断是否有值 | |
ifndef | 判断是否没有值 |
使用语法
ifeq (ARG1, arg2)# ifeq "ARG1" "ARG2"# ifeq 'ARG1' 'ARG2' xxxelse xxxendif
举例
gcc_libs = -lgnudefault_libs = ifeq ($(CC), gcc) libs = $(gcc_libs)else libs = $(default_libs)endiffoo : $(objects) $(CC) -o foo $(objects) $(libs)
使用语法:
ifdef VARIABLE_NAME
伪目标的含义是它并不会创建目标文件,但是会去执行这个目标下面的命令。使用伪目标有两点原因:
避免Makefile中只用来执行命令的目标与时间的文件出现名字冲突
提高执行make时的效率
文件清理操作clean作为伪目标的实现:
.PHONY : cleanclean : rm -rf *.o $(PROGRAM)
SUBDIRS = foo bar baz.PHONY : subdirs $(SUBDIRS)subdirs : $(SUBDIRS)$(SUBDIRS) : $(MAKE) -C $@foo: baz
上述脚本实现了递归的调用三个子目录下的make命令。
伪目标实现多目标文件的生成
如果想要在一个Makefile里控制生成多个可执行文件,也可以借助伪目标实现:
.PHONY allall : test1 test2 test3test1 : test1.o gcc -o $@ $^test2 : test2.o gcc -o $@ $^test3 : test3.o gcc -o $@ $^
上述脚本通过声明一个all伪目标,实现同时生成test1, test2, test3三个目标可执行文件。
Makefile中调用函数的语法:
$(<function> <arguments>)
或者 ${<function> <arguments>}
其中function是函数名,arguments是参数列表。函数名和参数列表之间用空格分开,参数列表中的多个参数用逗号分隔。
使用格式:
$(patsubst, , )
说明:查找text中符合模式pattern的部分,如果找到匹配的,则用replacement替换。返回替换后的新字符串。
常见用法示例:
C_SOURCE = $(shell find . -name *.c)C_OBJECTS=$(patsubst %.c, %.o, $(C_SOURCE))main : $(C_OBJECTS) gcc -o $@ $^$(C_OBJECTS) : $(C_SOURCE)
$(subst, , )
将text字符串中的from替换成to,返回替换后的新字符串
用法示例:
OBJ = $(subst Beijing, Shanghai, I love Beijing)all: @echo $(OBJ) # 显示 I love Shanghai
$(strip)
去掉string开头和结尾的空格,并且将中间连续多个空格合并为一个空格。返回去空格后的字符串。
$(findstring, )
在in中查找find,如果查找的目标字符串存在,返回目标字符串,如果不存在返回空。
用法示例
OBJ = $(findstring you, I hate you)all: @echo $(OBJ) # 显示 you
$(filter, )
过滤出text中符合模式pattern的字符串,可以有多个pattern,返回所有符合pattern的字符串。
用法示例:
OBJ = $(filter %.c %.o, foo1.c foo2.o foo3.s)all: @echo $(OBJ) #显示foo1.c foo2.o
$(filter-out, )
与filter函数相反,滤除所有符合pattern模式的字符串,返回所有不符合pattern的字符串。
OBJ = $(filter-out %.c %.o, foo1.c foo2.o foo3.s)all: @echo $(OBJ) #显示foo3.s
$(sort)
将list中的单词按照单词升序排序,返回排序后的字符串
示例:
OBJ = $(sort orange apple pear apple)all: @echo $(OBJ) # 显示 apple orange pear
notice : sort会去掉重复的字符串
$(word, )
取出字符串text中的第n个单词,返回取出的第n个单词。
示例:
OBJ = $(word 2, foo1.c foo2.c foo3.c)all: @echo $(OBJ) # 显示 foo2.c
$(dir)
从文件名序列names中取出所有文件的目录部分,如果文件名不包含任何路径,则取出的是“./”。返回文件序列的目录部分。
$(notdir)
从文件名序列names中取出所欲的非目录部分,返回取出的非目录部分。
$(suffix)
从文件名序列names中取出各个文件的后缀名,如果文件名没有后缀,则取出结果为空,返回取出的后缀名序列。
$(basename)
从文件名序列names中取出各个文件名的前缀部分(包含路径),返回取出的前缀名序列。
$(addsuffix, )
将后缀suffix添加到文件名列表names中的每个单词后面。返回添加后缀后的文件名序列。
$(addprefix, )
将前缀prefix添加到文件名序列names中的每个单词前面,返回添加前缀之后的文件名序列。
$(join, )
将list2中的单词一一对应的拼接到list1中的单词后,如果list1的单词比list2多,那么list1后面多出来的单词保持不变。如果list1的单词比list2少,那么list2后面多出来的单词保持不变。返回拼接之后的单词序列
$(wildcard PATTERN)
列出当前目录下所有符合模式的PATTERN格式的文件名,返回由空格分隔的当前目录下所有符合PATTERN模式的文件名。
OBJ = $(dir src/main.c src/module1.c inc/module1.h bsp.h)all: @echo $(OBJ) #显示 src/ src/ inc/ ./ OBJ = $(notdir src/main.c src/module1.c inc/module1.h bsp.h)all: @echo $(OBJ) #显示main.c module1.c module1.h bsp.h OBJ = $(suffix src/main.c src/module1.c inc/module1.h bsp.h)all: @echo $(OBJ) #显示.c .c .h .h OBJ = $(basename src/main.c src/module1.c inc/module1.h bsp.h)all: @echo $(OBJ) #显示 src/main src/module1 inc/module1 bspOBJ = $(addsuffix .c, src/main src/module1)all: @echo $(OBJ) #显示 src/main.c src/module1.c OBJ = $(addprefix src/, main.c module1.c)all: @echo $(OBJ) #显示 src/main.c src/module1.c OBJ = $(join main module1 module2, .c .h)all: @echo $(OBJ) #显示 main.c module1.h module2 OBJ = $(wildcard *.c *.h)main : $(OBJ) gcc -o $@ $^
$(foreach ,,
)
把参数list中的单词逐一取出放到参数var所指定的变量中,然后再执行text所包含的表达式,最终遍历完成后返回由空格分隔的遍历执行结果。
Notice foreach函数中的var是一个临时变量,作用域只在该函数中,执行结束后就不再起作用。
name = main module1 module2files = $(foreach n, $(name), $(n).o)all: @echo $(files) #显示 main.o module1.o module2.o
$(if, )$(if , , )
当condition为真,则执行then-part部分,否则执行else-part部分,返回执行结果,如果condition为假且else-part为空,则返回空字符串。condition为真的条件为condition为非空字符串。
OBJ = foo.cOBJ = $(if $(OBJ), $(OBJ), main.c)all: @echo $(OBJ) #显示 foo.c
$(call, , , , ...)
expression是一个包含参数的表达式,但call被执行时,expression中的参数变量$(1),$(2),$(3)等会被后面的参数parm1, parm2, parm3依次取代。最终返回替换完之后expression的值。
files = $(2).c $(1).cobj = $(call files, main, module)all: @echo $(obj) #显示 module.c main.c
$(origin)
origin 函数不会操作变量的值,他只会返回这个变量的来源。这里variable是变量的名字,不应该是引用,最好不要在variable中使用$字符。下面是origin函数的返回值:
返回值 | 说明 |
---|---|
undefined | variable从没有定义过 |
default | variable是默认定义的变量,如CC |
environment | variable是一个环境变量,并且makefile执行时没有-e选项 |
file | variable是在Makefile中定义的变量 |
command line | variable这个变量是被命令执行的 |
override | variable是被override指示符重新定义的 |
automatic | variable是一个命令行中的自动化变量 |
Makefile中可以通过include关键字来包含其他文件,当make命令遇到include关键字时,会暂停读取当前的Makefile,而是取读取include包含的文件,读取结束后再继续运行Makefile文件。具体用法如下:
include-include
上述两种使用方式的区别在于:
include <filenames>
,make 在处理程序的时候,文件列表中的任意一个文件不存在的时候或者是没有规则去创建这个文件的时候,make 程序将会提示错误并保存退出。-include <filenames>
,当包含的文件不存在或者是没有规则去创建它的时候,make 将会继续执行程序,只有真正由于不能完成终极目标重建的时候我们的程序才会提示错误保存退出。Notice :使用include包含进来的 Makefile 文件中,如果存在函数或者是变量的引用,它们会在包含的 Makefile 中展开。
subsystem: cd subdir && $(MAKE)
上述脚本使当前的make命令切换目录到指定的目录subdir,该目录下也有一个Makefile文件用于描述subdir下文件的编译规则,然后会再该目录下执行make命令,执行完之后再返回外层的make执行中。这样实现了make的嵌套执行,最外层的Makefile一般称为总控Makefile。
另一种写法是:
subsystem: $(MAKE) -C subdir
make的嵌套执行过程中,有一个系统变量“CURDIR”,它表示make的工作目录。当使用-C选项时,命令就会进入指定的目录中,此变量也会被重新赋值。
使用make嵌套执行时,如果需要传递变量,可以如下使用:
export
如果需要传递所有变量,直接使用export不添加变量名即可。
有两个变量SHELL和MAKEFLAGS在不管是否使用export关键字的情况下都会传递给被嵌套的Makefile。
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